3位二进制同步加法计数器(无效状态为001100)74LS161构成240进制同步计数器序列信号发生器.doc
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1、 目录 摘要.I 1 课程设计目的及要求 .11.1 课程设计的目的 .11.2 课程设计的要求 .12 3位二进制同步减法计数器(无效状态为001 100)12.1 基本原理 12.2 设计过程.1 2.2.1 状态图 1 2.2.2 卡诺图 1 2.2.3 特性方程,驱动方程 .32.3 设计电路图 .32.4 最后结果 43 序列信号发生器(101001) 83.1 基本原理 83.2设计过程 8 3.2.1 特性表 8 3.2.2 输出方程 93.3 设计电路图 93.4 最后结果 104 设计总结和体会 145 参考文献 15 1 课程设计目的及要求 1.1 课程设计的目的 1.学会
2、使用数字电子实验平台 2.熟悉各个芯片和电路的接法 3.熟练掌握设计触发器的算法 4.懂得基本数字电子电路的功能,会分析,会设计 1.2 课程设计的要求 1.设计3位二进制同步加法计数器(无效状态为001 100) 2.设计一个序列信号发生器(期序列为101001)2 设计3位二进制同步加法计数器(无效状态为001 100) 2.1 基本原理计数器是用来统计脉冲个数的电路,是组成数字电路和计算机电路的基本时序部件,计数器按进制分可分为:二进制,十进制和N进制。计数器不仅有加法计数器,也有减法计数器。一个计数器如果既能完成加法计数,又能完成减法计数,则其称为可逆计数器。同步计数器:当输入计数脉冲
3、到来时,要更新状态的触发器都是同时翻转的计数器,叫做同步计数器。设计同步计数器按照下面的思路进行分析!逻辑图最简逻辑表达式状态转换图状态赋值时序逻辑问题 选定触发器类型检查能否自启动2.2 设计过程 2.2.1 状态图 000111110101011010 2.2.2 卡诺图Q1nQ2nQ0n 00 01 11 100111xxx0100001xxx011110101 图 2.1Q1n Q2nQ0n 00 01 11 1001x001x011图 2.2Q1n+1的卡诺图 Q1n Q2nQ0n 00 01 11 1001x111x110图 2.3 Q1n Q2nQ0n 00 01 11 1001
4、x001x101图 2.42.2.3 驱动方程 状态方程 状态方程: =+ =+ =+ 驱动方程: J2= K2= J1=1 K1= J0= K0=2.3 设计电路图实验结果可通过数字显示器的数字变化和灯泡亮灭对比检验,较直观易懂,容易验证电路是否正确。实验用三片74LS112芯片,一片74LS00芯片,三个灯泡一个数码管,一个信号发生器组成。2.4 最后结果3位二进制同步减法计数器(其中的无效状态001 100)初始状态000 图2.6 状态一给一个脉冲变成111 图 2.7 状态二 给第二个脉冲变成110 图 2.8 状态三 给第三个脉冲变成101 图 2.9 状态四 给第四个脉冲变成01
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